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FPGA阻塞和非阻塞赋值的不同

FPGA

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FPGA阻塞和非阻塞赋值的不同，详细的介绍了阻塞和非阻塞赋值的差异，内附例子，包懂。

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深入理解阻塞和非阻塞赋值的

不同

概述

1 、阻塞赋值对应的电路往往与触发沿没有关

系 , 只与输入电平的变化有关系。阻塞赋值

符号 : =

2 非阻塞赋值对应的电路结构往往与触发沿有

关系，只有在触发沿时才有可能发生赋值的

情况。非阻塞赋值符号 : <=

阻塞赋值和非阻塞赋值

阻塞 (Blocking) 赋值方式 “ = ” ，如 b = a;

赋值语句执行完后 , 块才结束。

b 的值在赋值语句执行完后立刻就改变的。

非阻塞 (Non_Blocking) 赋值方式 “ < ＝”，如 b <= a;

块结束后才完成赋值操作。

b 的值并不是立刻就改变的。

这是一种比较常用的赋值方法（特别在编写可综合时序

模块时）。

阻塞赋值

阻塞赋值操作符用等号 ( 即 = ) 表示。阻塞赋值时先计算等

号右手方向（ RHS ）部分的值，这时赋值语句不允许任何别的

语句的干扰，直到现行的赋值完成时刻，即把 RHS 赋值给 LHS

的时刻，它才允许别的赋值语句的执行。

一般可综合的阻塞赋值操作在 RHS 不能设定有延迟， ( 即使

是零延迟也不允许 ) 。若在 RHS 加上延迟，则在延迟期间会阻

止赋值语句的执行 , 延迟后才执行赋值，这种赋值语句是不可

综合的，在需要综合的模块设计中不可使用这种风格的代码。

阻塞赋值的执行可以认为是只有一个步骤的操作：

所谓阻塞的概念是指在同一个 always 块中，其后面的赋值语

句从概念上（即使不设定延迟）是在前一句赋值语句结束后再

开始赋值的。

非阻塞赋值

非阻塞赋值操作符用小于等于号 ( 即 <= ) 表示。在赋值操

作时刻开始时计算非阻塞赋值符的 RHS 表达式，赋值操作时刻

结束时更新 LHS 。在计算非阻塞赋值的 RHS 表达式和更新 LHS 期

间，其他的 Verilog 语句，包括其他的 Verilog 非阻塞赋值语句

都能同时计算 RHS 表达式和更新 LHS 。非阻塞赋值允许其他的

Verilog 语句同时进行操作。

非阻塞赋值的操作可以看作为两个步骤的过程：

1) 在赋值时刻开始时，计算非阻塞赋值 RHS 表达式。

2) 在赋值时刻结束时，更新非阻塞赋值 LHS 表达式。

非阻塞赋值操作只能用于对寄存器类型变量进行赋值，因此只

能用在“ initial” 块和“ always” 块等过程块中。非阻塞赋值不

允许用于连续赋值。

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