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基于单片机与FPGA的等精度频率计的设计单片机部分
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更新于2023-11-22
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本设计论文以基于单片机与FPGA的等精度频率计的设计为课题,以AT89C51单片机作为系统的主控部件,FLEX EPF10K20RC208-4 FPGA芯片完成各种时序逻辑控制、计数功能。论文详细论述了等精度数字频率计的测频原理、硬件电路的组成、设计和单片机软件编程设计、系统的误差分析。硬件电路包括键盘控制模块、显示模块和测量模块,键盘模块采用独立式的键盘,实现了测频功能,还实现了周期、脉宽、占空比测量等功能的选择;显示模块采用静态显示方式,因此电路结构简单,显示方便;AT89C51单片机的软件编程采用灵活易读的C语言。本设计将AT89C51单片机的控制灵活性和FPGA芯片的现场可编程性相结合,不但大大缩短了开发研制周期,而且使本系统具有结构紧凑、体积小、可靠性高、测频范围宽、精度高等优点。
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当方波预置门控信号 CL 可由单片机发出,CL 的时间宽度对测频精度影响较小,所
以可以在 1 秒至 0.1 秒间选择,在此设其宽度为 Tpr。BZH 和 TF 模块是两个可控的 32
位高速计数器,BENA 和 ENA 分别是它们的计数允许信号端,高电平有效。
标准频率信号从 BZH 的时钟输入端 BCLK 输入,设其频率为 Fs;经整形后的被测
信号从与 BZH 相似的 32 位计数器 TF 的时钟输入端 TCLK 输入,设其真实频率为 Fxe,
被测频率为 Fx。测频原理说明如下:
测频开始前,首先发出一个清零信号 CLR,使两个计数器和 D 触发器置零,同时通
过信号 ENA 禁止两个计数器计数。这是一个初始化操作。
然后由单片机发出允许测频命令,即令预置门控信号 CL 为高电平,这时 D 触发器
要一直等到被测信号的上升沿通过时 Q 端才被置 1,与此同时,将同时启动计数器 BZH
和 TF,进入“计数允许周期”。在此期间,BZH 和 TF 分别对标准频率信号(频率为 Fs)
和被测信号(频率为 Fx)同时计数。当 Tpr 秒后,预置门控信号 CL 被单片机置为低电
平,但此时两个计数器仍没有停止计数,一直等到随后而至的被测信号的上升沿到来时,
才通过 D 触发器将把这两个计数器同时关闭。
设 Fx 为整形后的被测信号频率,Fs 为基准信号频率,设在一次预置门时间 Tpr 中
对被测信号的计数值为 Nx,对标准频率信号的计数值为 Ns,则有下式成立:
(2-3)
不难得到测得的频率为:
(2-4)
最后通过控制 SEL 选择信号和 64 位至 8 位的多路选择器 MUX64-8,将计数器 BZH
和 TF 中的两个 32 位数据分 8 次读入单片机并按式(2-4)进行计算和结果的显示。
Fx Fs
Nx Ns
=
Fs
Fx Nx
Ns
= ´
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2.2 等精度数字频率计的设计方法
2.2.1 电子系统的设计方法
现代电子系统一般由模拟子系统、数字子系统和微处理器子系统三大部分组成。从
概念上讲,凡是利用数字技术处理和传输信息的电子系统都可以称为数字系统。传统的
数字系统设计只能对电路板进行设计,通过设计电路板来实现系统功能。利用 EDA 工
具,采用可编程器件,通过设计芯片来实现系统功能,这种方法称为基于芯片的设计方
法。新的设计方法能够由设计者定义器件的内部逻辑,将原来由电路板设计完成的大部
分工作放在芯片的设计中进行。这样不仅可以通过芯片设计实现多种数字逻辑系统,而
且由于管脚定义的灵活性,大大减轻了电路图设计和电路板设计的工作量和难度,从而
有效的增强了设计的灵活性,提高了工作效率。同时,基于芯片的设计可以减少芯片的
数量,缩小系统体积,降低能源消耗。图 2-2 所示为电子系统的传统设计方法和基于芯
片的设计方法。
图 2-2(a)传统设计方法 (b)基于芯片设计方法
可编程逻辑器件和 EDA 技术给今天的硬件系统设计者提供了强有力的工具,使得
电子系统的设计方法发生了质的变化。现在,只要拥有一台计算机、一套相应的 EDA
软件和空白的可编程逻辑器件芯片,在实验室里就可以完成数字系统的设计和生产。
固定功能元件
电子系统
电路板的设计
电子系统
芯片设计
可编程器件
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第三章 主要芯片及设计工具简介
3.1 主要芯片性能介绍
3.1.1 AT89C51 单片机性能介绍
图 3-1 AT89C51 引脚图
AT89C51 是一个内含 4K 字节可编程可擦除的快闪存储器(Flash Memory)和 128 个
字
节 RAM,低电压,高性能 CMOS 结构的 8 位单片机。采用 ATMEL 高密度非易失存储
器制造技术制造,与工业标准的 MCS-51 指令集和输出管脚相兼容。由于将多功能 8 位
CPU 和快闪存储器组合在单个芯片中,ATMEL 的 AT89C51 是一种高效微控制器,为很
多嵌入式控制系统提供了一种灵活性高且价廉的方案。
⑴ AT89C51 的主要特性如下:
●与 MCS-51 兼容
●4K 字节可编程快闪存储器
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●寿命:1000 次写/擦
●数据保留时间:十年
●128*8 位内部 RAM
●32 可编程 I/0 线
●两个 16 位定时器/计数器
●五个中断源
●可编程串行通道
●低功耗的闲置和掉电模式
●片内振荡器和时钟电路
⑵ 其管脚的具体说明如下:
VCC: 供电电压
GND: 接地
P0 口:P0 口为一个 8 位漏级开路双向 I/O 口,每个引脚可驱动 8 个 TTL 门电流。
当 P1 口的管脚输入数据时,应先把口置‘1’。作为外部地址/数据总线使用时,用于传
送 8 位数据和低 8 位地址。在快闪编程时,P0 口输入,当快闪进行校验时,P0 口输出,
此时 P0 外部必须被拉至高电平。
P1 口:P1 口是一个内部提供上拉电阻的 8 位双向 I/O 口,P1 口缓冲器能驱动 4 个
TTL 门。P1 口管脚写入‘1’后,被内部上拉为高,可用作输入。P1 口被外部下拉为低
电平时,将输出电流,这是由于内部上拉的缘故。
P2 口:P2 口是一个内部提供上拉电阻的 8 位双向 I/0 口,P2 口缓冲器可驱动 4 个
TTL 门电流,当 P2 口被写‘1 ’时,其管脚被内部上拉电阻拉高,且作为输入。并因
此作为输入时,P2 口被外部下拉为低电平时,将输出电流,这是由于内部上拉的缘故。
P1 口当用作外部程序存储器或外部数据存储器进行存取时,P2 口输出 16 位地址的高八
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