TI DS90C383/DS90CF384：FPD-Link 65MHz LVDS Transceivers for 24-bi...
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更新于2024-06-27
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TI公司的DS90C383/DS90CF384是一对针对FPD-Link（Flat Panel Display Link）标准设计的高度集成的接口芯片，用于24位高带宽显示数据传输。FPD-Link是一种高速接口技术，特别适用于平板显示器（Flat Panel Display）之间的连接，其工作频率高达65MHz。
DS90C383是发射器组件，它将28位的CMOS/TTL数据转换成四个低电压差分信号（LVDS）数据流，同时发送一个相位锁定的时钟信号。这个时钟信号与数据流同步，确保数据的精确传输。每个时钟周期内，输入的28位数据会被采样并打包成LVDS格式发送出去。这款发射器提供可编程边沿数据脉冲，以适应不同应用中的接口需求。
DS90CF384则是接收器，它接收并解码这四个LVDS数据流，将其还原为原始的28位CMOS/TTL数据。在65MHz的时钟频率下，它能够处理24位的RGB数据和3位的LCD控制和定时数据，如FPLINE、FPFRAME和DRDY。每条LVDS数据通道的传输速率高达455Mbps，这意味着在65MHz时钟下，整体的数据吞吐量达到了惊人的227兆字节/秒，非常适合高清晰度视频的实时传输。
这些芯片的主要优点包括高带宽、低功耗和灵活性，它们能简化设计师在平板显示器系统中的接口设计，并支持多种显示器类型和刷新率。此外，通过可编程特性，工程师可以根据具体项目需求调整数据传输特性，增加了系统的兼容性和适应性。
DS90C383/DS90CF384是现代电子系统中FPD-Link通信链路的核心组件，它们在平板显示技术的发展中起着至关重要的作用，为高性能图像处理和显示应用提供了高效的数据传输解决方案。
Electrical Characteristics (Continued)
Over recommended operating supply and temperature ranges unless otherwise specified.
Symbol Parameter Conditions Min Typ Max Units
TRANSMITTER SUPPLY CURRENT
ICCTG Transmitter Supply Current R
L
= 100Ω,
C
L
= 5 pF,
f = 32.5 MHz 23 35 mA
16 Grayscale 16 Grayscale Pattern f = 37.5 MHz 28 40 mA
(Figures 2, 3 )
,T
A
=
−40˚C to +85˚C
f = 65 MHz 31 45 mA
ICCTZ Transmitter Supply Current Power Down = Low
10 55 µA
Power Down Driver Outputs in TRI-STATE
®
under
Power Down Mode
RECEIVER SUPPLY CURRENT
ICCRW Receiver Supply Current C
L
= 8 pF, f = 32.5 MHz 49 65 mA
Worst Case Worst Case Pattern f = 37.5 MHz 53 70 mA
(Figures 1, 4 )
,T
A
=
−40˚C to +85˚C
f = 65 MHz 78 105 mA
ICCRG Receiver Supply Current, C
L
= 8 pF, f = 32.5 MHz 28 45 mA
16 Grayscale 16 Grayscale Pattern f = 37.5 MHz 30 47 mA
(Figures 2, 4 )
,T
A
=
−40˚C to +85˚C
f = 65 MHz 43 60 mA
ICCRZ Receiver Supply Current Power Down = Low
10 55 µA
Power Down Receiver Outputs Stay Low during
Power Down Mode
Note 1: “Absolute Maximum Ratings” are those values beyond which the safety of the device cannot be guaranteed. They are not meant to imply that the device
should be operated at these limits. The tables of “Electrical Characteristics” specify conditions for device operation.
Note 2: Typical values are given for V
CC
= 3.3V and T
A
= +25C.
Note 3: Current into device pins is defined as positive. Current out of device pins is defined as negative. Voltages are referenced to ground unless otherwise speci-
fied (except V
OD
and ∆V
OD
).
Note 4: V
OS
previously referred as V
CM
.
Transmitter Switching Characteristics
Over recommended operating supply and −40˚C to +85˚C ranges unless otherwise specified
Symbol Parameter Min Typ Max Units
LLHT LVDS Low-to-High Transition Time
(Figure 3 )
0.75 1.5 ns
LHLT LVDS High-to-Low Transition Time
(Figure 3 )
0.75 1.5 ns
TCIT TxCLK IN Transition Time
(Figure 5 )
5ns
TCCS TxOUT Channel-to-Channel Skew
(Figure 6 )
250 ps
TPPos0 Transmitter Output Pulse Position for Bit 0
(Figure 17 )
f = 65 MHz −0.4 0 0.3 ns
TPPos1 Transmitter Output Pulse Position for Bit 1 1.8 2.2 2.5 ns
TPPos2 Transmitter Output Pulse Position for Bit 2 4.0 4.4 4.7 ns
TPPos3 Transmitter Output Pulse Position for Bit 3 6.2 6.6 6.9 ns
TPPos4 Transmitter Output Pulse Position for Bit 4 8.4 8.8 9.1 ns
TPPos5 Transmitter Output Pulse Position for Bit 5 10.6 11 11.3 ns
TPPos6 Transmitter Output Pulse Position for Bit 6 12.8 13.2 13.5 ns
TCIP TxCLK IN Period
(Figure 7)
15 T 50 ns
TCIH TxCLK IN High Time
(Figure 7)
0.35T 0.5T 0.65T ns
TCIL TxCLK IN Low Time
(Figure 7)
0.35T 0.5T 0.65T ns
TSTC TxIN Setup to TxCLK IN
(Figure 7 )
f = 65 MHz 2.5 ns
THTC TxIN Hold to TxCLK IN
(Figure 7 )
0ns
TCCD TxCLK IN to TxCLK OUT Delay 25˚C, V
CC
= 3.3V
(Figure 9 )
3.0 3.7 5.5 ns
TPLLS Transmitter Phase Lock Loop Set
(Figure 11 )
10 ms
TPDD Transmitter Power Down Delay
(Figure 15 )
100 ns
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