74ls373引脚图及功能

74LS373是一种8位透明锁存器，它有以下引脚和功能：

引脚图：

        +---+--+---+
  OE -- |1  +--+ 20|-- Vcc
 D0~D7 -- |2       19|-- D7
 /MR -- |3       18|-- D6
CLK -- |4       17|-- D5
 ST -- |5       16|-- D4
 GND -- |6       15|-- D3
 Q0~Q7 -- |7       14|-- D2
  LE -- |8       13|-- D1
       |9       12|-- D0
       +---------+

功能：

- OE (输出使能)：当OE为高电平时，输出被禁止。
- D0~D7 (数据输入)：这是8位并行输入端口，在时钟上升沿时，输入数据从这里输入。
- /MR (清除)：当/MR为低电平时，锁存器被清零，所有的Q输出被拉低。
- CLK (时钟)：时钟上升沿时，数据从输入端口D0~D7传输到输出端口Q0~Q7。
- ST (存储器使能)：当ST为低电平时，锁存器的状态被存储。
- Q0~Q7 (数据输出)：这是8位并行输出端口，输出数据从这里输出。
- LE (锁存器使能)：当LE为低电平时，锁存器的状态被锁定。

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74ls161引脚图及功能

74LS161是一种4位二进制同步计数器，能进行模M=16的加法计数。它有两个时钟输入，一个是CP时钟输入，一个是MR时钟输入。CP时钟输入用于计数，MR时钟输入用于清零计数器。它还有一个异步清零输入，一个并行加载输入和四个并行输出。以下是74LS161的引脚图及功能：


1. CP时钟输入：用于计数，每上升沿计数器加1。
2. MR时钟输入：用于清零计数器，当MR为低电平时，计数器清零。
3. P0-P3并行数据输入：用于并行加载，当PL为低电平时，P0-P3的数据被加载到计数器中。
4. PL并行加载输入：当PL为低电平时，P0-P3的数据被加载到计数器中。
5. TC输出：计数器溢出时输出高电平。
6. Q0-Q3并行输出：计数器的四个位的输出。
7. GND：接地。
8. QD输出：计数器的最高位输出。
9. CPD时钟输入：用于异步清零，当CPD为低电平时，计数器清零。
10. VCC：电源正极。

74ls192引脚图及功能表

74LS192是一种4位上升计数器，具有下面所列的功能和引脚：

引脚图如下所示：
引脚1和16：VCC，正电源输入
引脚8和9：清零输入
引脚15和10：时钟输入
引脚12和13：并行输出
引脚11：串行输出
引脚2、3、4、5、6、7、14：接地

功能表如下：
1.引脚VCC为74LS192的正电源输入引脚，用于连接外部电源供电。
2.引脚清零输入（CLR）为异步清零输入端，当有低电平信号输入时，可以将计数器清零。
3.引脚时钟输入（CP0、CP1）用于计数器的时钟信号输入，用于触发计数器的计数功能。
4.引脚并行输出（QA、QB、QC、QD）为计数器的并行输出端，可以直接输出当前计数器的数值。
5.引脚串行输出（QD）为计数器的串行输出端，当需要将数值联接到其他模块时可以使用。
6.引脚GND为74LS192的接地引脚，用于连接外部地线。

74LS192是一种经典的计数器芯片，适用于数字电子技术中的计数和控制电路。以上是74LS192的引脚图及功能表的相关介绍。